[服務(wù)項(xiàng)目]主題： PCB時(shí)鐘線(xiàn)的處理—DIP生產(chǎn) ... 發(fā)布者： DIP生產(chǎn)
05/30/2018
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PCB時(shí)鐘線(xiàn)的處理—DIP生產(chǎn)
在PCB時(shí)鐘電路區(qū)域只布與時(shí)鐘電路有關(guān)的器件，避免布設(shè)其他電路，晶體附近或者下面不要布其他 信號(hào)線(xiàn)：SMT貼片加工公司指出，在時(shí)鐘發(fā)生電路、晶體下使用地平面，若其他信號(hào)穿過(guò)該平面，違反了映像平面功能，如果 讓信號(hào)穿越這個(gè)地平面的話(huà)，就會(huì)存在很小的地環(huán)路并影響地平面的連續(xù)性，這些地環(huán)路在高頻時(shí)將會(huì)產(chǎn)生問(wèn)題。
PCB時(shí)鐘線(xiàn)的處理——DIP生產(chǎn)廠(chǎng)家來(lái)為大家娓娓道來(lái)：
一：建議先走時(shí)鐘線(xiàn)“”
二：
頻率大于等于66M的時(shí)鐘線(xiàn)，每條過(guò)孔數(shù)不要超過(guò)2個(gè)，平均不得超過(guò)1.5個(gè)。
三：
頻率小于66M的時(shí)鐘線(xiàn)，每條過(guò)孔數(shù)不要超過(guò)3個(gè)，平均不得超過(guò)2.5個(gè)
四：
長(zhǎng)度超過(guò)12inch的時(shí)鐘線(xiàn)，如果頻率大于20M，過(guò)孔數(shù)不得超過(guò)2個(gè)。
五：
如果時(shí)鐘線(xiàn)有過(guò)孔，在過(guò)孔的相鄰位置，在第二層(地層)和第三層(電源層)之間加一個(gè)旁路 電容，以確保時(shí)鐘線(xiàn)換層后，參考層(相鄰層)的高頻電流的回路連續(xù)。PCBA打樣廠(chǎng)家指出，旁路電容所在的電源層必須是 過(guò)孔穿過(guò)的電源層，并盡可能地靠近過(guò)孔，旁路電容與過(guò)孔的間距至大不超過(guò)300MIL。過(guò)孔處的旁路電容
六：
所有時(shí)鐘線(xiàn)原則上不可以穿島。下面列舉了穿島的四種情形。
1.跨島出現(xiàn)在電源島與電源島之間。此時(shí)時(shí)鐘線(xiàn)在第四層的背面PCB走線(xiàn)，第三層(電源層) 有兩個(gè)電源島，且第四層的PCB走線(xiàn)必須跨過(guò)這兩個(gè)島。
2.跨島出現(xiàn)在電源島與地島之間。此時(shí)時(shí)鐘線(xiàn)在第四層的背面PCB走線(xiàn)，第三層(電源層)的 一個(gè)電源島中間有一塊地島，且第四層的PCB走線(xiàn)必須跨過(guò)這兩個(gè)島。
3. 跨島出現(xiàn)在地島與地層之間。此時(shí)時(shí)鐘線(xiàn)在第一層PCB走線(xiàn)，第二層(地層)的中間有一塊 地島，且第一層的PCB走線(xiàn)必須跨過(guò)地島，相當(dāng)于地線(xiàn)被中斷。
4.時(shí)鐘線(xiàn)下面沒(méi)有鋪銅。若條件限制實(shí)在做不到不穿島，保證頻率大于等于66M的時(shí)鐘線(xiàn)不 穿島，頻率小于66M的時(shí)鐘線(xiàn)若穿島，必須加一個(gè)去耦電容形成幻像通路。在兩個(gè)電源島之間并靠近 跨島的時(shí)鐘線(xiàn)，放置一個(gè)0.1UF的電容。
七：
當(dāng)面臨兩個(gè)過(guò)孔和一次穿島的取舍時(shí)，選一次穿島。
八：
時(shí)鐘線(xiàn)要遠(yuǎn)離I/O一側(cè)板邊500MIL以上，并且不要和I/O線(xiàn)并行走，若實(shí)在做不到，時(shí)鐘線(xiàn)與 I/O口線(xiàn)間距要大于50MIL。
九：
時(shí)鐘線(xiàn)走在第四層時(shí)，時(shí)鐘線(xiàn)的參考層(電源平面)應(yīng)盡量為時(shí)鐘供電的那個(gè)電源面上，以其 他電源面為參考的時(shí)鐘越少越好，另外，頻率大于等于66M的時(shí)鐘線(xiàn)參考電源面必須為3.3V電源平面 ——OEM代加工廠(chǎng)家友情指出！
十：時(shí)鐘線(xiàn)打線(xiàn)時(shí)線(xiàn)間距要大于25MIL。
十一：
時(shí)鐘線(xiàn)打線(xiàn)時(shí)進(jìn)去的線(xiàn)和出去的線(xiàn)應(yīng)該盡量遠(yuǎn)。盡量避免類(lèi)似圖A和圖C所示的打線(xiàn)方式， 采用類(lèi)似圖B和圖D的打線(xiàn)方式，若時(shí)鐘線(xiàn)需換層，避免采用圖E的打線(xiàn)方式，采用圖F的打線(xiàn)方式。
十二：
時(shí)鐘線(xiàn)連接BGA等器件時(shí)，若時(shí)鐘線(xiàn)換層，盡量避免采用圖G的PCB走線(xiàn)形式,過(guò)孔不要在 BGA下面走,至好采用圖H的PCB走線(xiàn)形式。
十三：
注意各個(gè)時(shí)鐘信號(hào)，不要忽略任何一個(gè)時(shí)鐘，包括AUDIO CODEC的AC_BITCLK，尤其注意的 是FS3-FS0,雖然說(shuō)從名稱(chēng)上看不是時(shí)鐘，但實(shí)際上跑的是時(shí)鐘，要加以注意。
十四：
Clock Chip上拉下拉電阻盡量靠近Clock Chip。
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最后更新: 2018-05-30 10:53:02
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